作者:张博; 陶晓旭; 刘宇 期刊:《西安邮电大学学报》 2019年第05期
根据JESD204B协议,设计了一种应用于8 Gsps 12 bit模数转换器(analog-to-digital,ADC)接口电路中的8B10B编码器。该编码器采用双字节并行实现方案将系统时钟由500 MHz降低至250 MHz,通过添加1 bit均衡指示位,使得极性信息先于编码结果产生,减少了极性计算与传递引起的延迟;使用负极性编码,减小对查找表资源的使用。实验结果表明,该编码器能够支持12.9 Gbps的最大通道传输速率,相比级联型编码器和单字节编码器数据传输速率更高。所...
多通道数据同步采集传输是信号采集系统要解决的关键问题。针对多通道数据采集系统前端模拟部分与后端数字信号处理部分高速同步传输面临的挑战,文中介绍了采用基于JESD204B协议的模数/数模转换器(ADC/DAC)与现场可编程门阵列相结合的数据同步传输设计,简述了该系统的基本架构。对基于JESD204B标准子类1的多通道数据采集传输过程中的延时原因进行了分析,利用JESD204B标准子类1同步原理,通过关键控制信号的设计和处理,可以实现接收...
作者:周希辰; 张志武; 翟刚毅; 李云飞 期刊:《雷达与对抗》 2018年第01期
为了解决宽带项目并行总线中PCB布局复杂和高数据速率传输的问题,设计一款基于ADI公司最新DAC产品AD9144的信号发生器。对DAC芯片集成的JESD204B接口协议进行研究,以Xilinx公司的K7C325TFPGA为主控芯片,利用FPGA中的高速串行收发器GTX,实现JESD204B接口,完成单lane6Gbps的数据率传输,并结合硬件电路,实现了任意调制信号从基带到高中频的高质量产生,满足了协同的设计需要。
作者:蒋林; 衡茜; 张春茗; 邓军勇; 王喜娟 期刊:《电子技术应用》 2018年第08期
高性能数据转换器是第五代移动通信基站系统的核心器件,其采样速率不低于3 GS/s、分辨率高于12 bit,因此高速串行接口取代传统接口电路成为必然趋势。基于JESD204B协议设计了一种应用于3 GS/s 12 bit ADCs的高速串行接口控制层电路。在保证高速传输的前提下,折中考虑功耗和资源,该电路在传输层采用预分频技术完成组帧;在数据链路层采用极性信息简化编码技术实现8 B/10 B编码。在Vivado 16.1环境下,采用Xilinx公司的ZC706 FPGA中PHY...
作者:朱超; 屈晓旭; 娄景艺 期刊:《通信技术》 2017年第11期
传统的传输方式多使用并行进行数据采样。并行传输方式不仅存在信号同步难、线间串扰大等缺点,而且PCB布局布线繁琐、板层多、成本高等。JESD204B作为一种新的高速串行转换器接口,其使用率正在稳步上升,且有望成为未来转换器的协议标准。首先简要介绍JESD204B协议的历史发展过程,其次详细阐述JESD204B协议接口结构,包含应用层、传输层、数据链路层、物理层,最后从芯片、接口应用和设计挑战方面综述基于JESD204B协议的高速串行接口...
作者:欧阳靖; 姚亚峰; 霍兴华; 谭宇 期刊:《电子设计工程》 2017年第07期
作为JEDEC最新修订的AD/DA串行传输协议,JESD204B采用自同步扰码对数据链路层原始信号进行随机化转换,有效地避免了杂散频谱产生.减少了物理层误码概率。本文基于经典状态机结构对JESD204B协议中自同步加扰及解扰电路进行设计实现,文章阐述了协议中自同步扰码的原理细节,提出了一种加扰与解扰状态电路的设计方案,最终对该方案进行实现、仿真与综合。仿真与综合结果表明该方案充分兼容协议控制信号,功能完全符合协议要求....
作者:焦喜香; 吴兵; 李武建; 向海生 期刊:《信息通信》 2016年第06期
JESD204B协议的广泛运用以及其带来的好处,为雷达接收机提高集成度实现高速采集提供了可能。介绍了采用基于JESD204B协议的AD9680 ADC与可实现ESD204B协议数据帧解码的FPGA的高速雷达数字接收机的设计,简述了该接收机的系统架构,详细地阐述了数据帧解码的软件设计以及结合FPGA逻辑分析软件Chipscope和Matlab程序对系统的指标进行测试。