首页 期刊 南京师范大学学报·工程技术版 基于半随机矩阵的LDPC编码器的Verilog HDL设计 【正文】

基于半随机矩阵的LDPC编码器的Verilog HDL设计

作者:尹晓琦; 殷奎喜; 赵华; 柯伟 南京师范大学物理科学与技术学院; 江苏南京210097; 淮阴工学院电了信息工程系; 江苏淮安223001
ldpc码   半随机校验矩阵   veriloghdl  

摘要:低密度奇偶校验码(Low-Density-Parity-Checkcodes,LDPC码)是第四代通信系统强有力的竞争者,是一种逼近香农限的线性分组码,译码的复杂度较低;其直接编码运算量较大,通常具有码长的二次方复杂度.介绍了如何构造线性的编码,以降低LDPC码的编码复杂度;研究并设计了用大规模集成电路去实现“一个LDPC码的编码.以(6,2,3)码为例,采用基于半随机校验矩阵的编码方法,以控制编码运算景为线性复杂度,并在Quartusll 5.0软件平台上采用基于CPLD的VefilogHDL语言编程仿真实现了编码的过程,给出了编码的结构图和仿真波形,为LDPC码的硬件实现和实际应用提供了依据.

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